Ampliaci\u00f3n flexible de E\/S para sistemas de avi\u00f3nica<\/p>\n
El subsistema de expansi\u00f3n de E\/S A175 de Aitech es una peque\u00f1a unidad adicional para sistemas de avi\u00f3nica dise\u00f1ada especialmente para:
\n\u2022 Ampliar las capacidades de E\/S de los sistemas de avi\u00f3nica existentes
\n\u2022 Admitir E\/S de avi\u00f3nica con se\u00f1ales sensibles<\/p>\n
Con su amplia variedad de interfaces de E\/S, su tama\u00f1o compacto, su bajo consumo y su interfaz de bus de avi\u00f3nica MIL-STD-1553B (RT) est\u00e1ndar
\n, el A175 cumple con creces estos requisitos. Se puede utilizar para ampliar
\nlas capacidades de E\/S de cualquier ordenador de avi\u00f3nica que cuente con una interfaz est\u00e1ndar MIL-STD-1553B. <\/p>\n
En el caso de se\u00f1ales sensibles, la unidad se puede instalar muy cerca de los sensores, lo que permite un cableado corto para garantizar
\nla m\u00e1xima integridad de la se\u00f1al y la m\u00ednima p\u00e9rdida de se\u00f1al.<\/p>\n
El A175 es ideal para ampliar las capacidades de los sistemas de avi\u00f3nica existentes, gracias a su capacidad de escalabilidad
\n, que se consigue mediante unidades adicionales que se pueden conectar como esclavas al ordenador de avi\u00f3nica principal. El n\u00famero de \u00ab
\n\u00bb que se pueden a\u00f1adir solo est\u00e1 limitado por las capacidades del ordenador de avi\u00f3nica principal. <\/p>\n
Todas las interfaces de E\/S est\u00e1n implementadas en la FPGA de la unidad, y solo las capas f\u00edsicas est\u00e1n asignadas a dispositivos d
\n. Esto minimiza el consumo de energ\u00eda y permite personalizar f\u00e1cilmente la unidad para adaptarla a aplicaciones espec\u00edficas
\n. <\/p>\n
Para garantizar la m\u00e1xima fiabilidad, el A175 incluye amplias capacidades de prueba integrada (BIT). Cada l\u00ednea de salida discreta
\nse conecta a una entrada discreta dedicada para permitir las pruebas de bucle cerrado. (Estas entradas discretas dedicadas
\nse suman a las entradas discretas disponibles en los conectores de E\/S). La FPGA compara las se\u00f1ales de entrada
\ny de salida, y escribe un bit de estado de funcionamiento para cada canal en los registros de la FPGA, a los que la CPU del ordenador de avi\u00f3nica puede acceder
\na trav\u00e9s del enlace MIL-STD-1553B. <\/p>\n","protected":false},"excerpt":{"rendered":"
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